Laboratorio#4 Public

Se realiza implementación de un Public con display 16 segmentos, se implementa u reloj y un contador los cuales entran a la memoria ROM, la salida de la Memoria ROM es un vector de 8 bit, para poder ingresar este dato a nuestro decodificador alfanumérico, se realiza implementación  de un conversor paralelo serie y las salidas las ingresamos al conversor alfanumérico, el alfanumérico solo tiene seis entradas y nuestro conversor paralelo serie nos da ocho salidas los dos bits mas significativos los ingresamos a dos leds.


Posición y dato en memoria ROM


Conversor paralelo serie



Esquematico Xilinx

Evidencia entrega laboratorio.




Comentarios

Publicar un comentario

Entradas populares de este blog

Laboratorio #2 Decodificador Alfanumerico

Imagen
Se realiza diseño e implementación de un decodificador alfanumérico con display de 16 segmentos, el cual nos permite hacer una visualización de todo el alfabeto y los números del 0 al 9. Se utiliza un contador ascendente con flil-flops de 6 bits, utilizando como entrada de reloj un pulsador y otro para reiniciar el conteo, la salida de cada flip-flop va a una compuerta negadora ya que el decodificador detecta flacos de subida, de igual forma a la salida del decodificador se colocan compuertas negadoras ya que la salida son de lógica negada. Diseño de Visualización display 16 Segmentos Tabla de Diseño Diseño en Xilinx Evidencia entrega laboratorio #2
Leer más

Prototipo banda clasificadora de cajas por tamaño en FPGA

Imagen
El principal objetivo de este prototipo es poder clasificar cajas de 2 diferentes tamaños y saber la cantidad de cada una de estas. Para la implementación del diseño se utilizara el lenguaje de programación VHDL, implementando una maquina de estados tipo Moore. A continuación una descripción de los elementos utilizados Para sistemas automatizados las FPGA brindan gran facilidad para su implementación, con la ayuda del  lenguaje VHDL y estructura esquemática Para el ingreso de señales de los sensores a la FPGA es un poco dispendioso hacer los diferentes tipos de acoples que se necesitan ya que esta reconoce como entrada de 1 logico el valor de 3.3 voltios.  Al momento de realizar el programa con en lenguaje VHDL se facilita el uso de diagrama esquemático el cual nos ayuda a identificar con facilidad en punto o parte se puede estar presentando algún problema. https://mega.nz/#!PkVW0Zob!-FSiCF2S2hHRPndvFz4ZTpUHpG8RbS1LysQ3h4EAcys
Leer más